新款A(yù)RC HS處理器的多核版本包括一個創(chuàng)新的互連結(jié)構(gòu)，可連接多達12個核心，支持多達16個硬件加速器的接口，同時保持核心之間的一致性。

 新款A(yù)RC HS處理器可配置用于實時運行，或配置支持對稱多處理(SMP) Linux和其他高端操作系統(tǒng)的高級內(nèi)存管理單元(MMU)。為了加速軟件開發(fā)，ARC HS5x和HS6x處理器由ARC metaWare開發(fā)工具(http://www.weberwork.com/sell/l_5/)套件提供支持，可生成高效代碼。

  新款A(yù)RC HS處理器可滿足各種高端嵌入式應(yīng)用的功耗、性能和面積要求，包括固態(tài)硬盤(SSD)、汽車(http://www.weberwork.com/sell/l_15/)控制和信息娛樂、無線基帶、無線控制和家庭網(wǎng)絡(luò)。

 

  ARC HS5x和ARC HS6x處理器基于新的ARCv3 ISA，支持各種32位和64位指令。這些處理器具有高速10級、雙發(fā)射流水線，在功耗和面積有限的情況下提高了功能單元的利用率。

  HS5x處理器的32位流水線可以執(zhí)行所有ARCv3 32位指令，而HS6x處理器的64位流水線和寄存器文件可以執(zhí)行32位和64位指令。

  ARC HS6x支持64位虛擬地址空間和52位物理地址空間，可以直接尋址當(dāng)前和未來的大內(nèi)存，并支持128位加載和存儲，以實現(xiàn)高效的數(shù)據(jù)移動。

  ARC HS5x和HS6x處理器的多核版本都包括先進的高帶寬處理器內(nèi)部互連，通過異步時鐘和高達800 GB/s的內(nèi)部聚合帶寬來簡化開發(fā)和時序收斂。為了進一步簡化多核配置中的物理設(shè)計和時序收斂，每個核位于自己的功率域中，并且與其他核具有異步時鐘關(guān)系。

  新的128位矢量浮點單元支持F16、F32和F64操作，具有2個周期的累積延遲。跟所有ARC處理器一樣，HS5x和HS6x處理器都高度可配置，并采用ARC Processor EXtension (APEX)技術(shù)，支持自定義指令，可滿足每個目標(biāo)應(yīng)用的獨特性能、功耗和面積要求。

 

  HS5x和HS6x處理器由新思科技的ARC metaWare開發(fā)工具套件提供支持，其中包括一個針對處理器超標(biāo)量架構(gòu)進行優(yōu)化的高級C/C++編譯器，一個用于調(diào)試和分析代碼的多核調(diào)試器，以及一個用于硬件前軟件開發(fā)的快速指令集模擬器(ISS)。周期精確的模擬器可用于設(shè)計優(yōu)化和驗證。

  處理器的開源軟件支持包括Zephyr實時操作系統(tǒng)、優(yōu)化的Linux內(nèi)核、GNU編譯器集合(GCC)、GNU調(diào)試器(GDB)和相關(guān)的GNU編程實用程序（二進制工具）。第三方合作伙伴提供了其他硬件和軟件工具，使開發(fā)人員能夠靈活地為其設(shè)計項目選擇最好和最熟悉的工具。